| FPGA與DSP聯合應用 |
班級規模及環境--熱線:4008699035 手機:15921673576( 微信同號) |
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每期人數限3到5人。 |
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時間地點 |
上課地點：【上海】：同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】：北京中山學院/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領館區1號（中和大道） 【沈陽分部】：沈陽理工大學/六宅臻品 【鄭州分部】：鄭州大學/錦華大廈 【石家莊分部】：河北科技大學/瑞景大廈 【廣州分部】：廣糧大廈 【西安分部】：協同大廈
最近開課時間(周末班/連續班/晚班）：FPGA和DSP聯合班：2025年4月7日--即將開課-----即將開課，歡迎垂詢 |
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學時和費用 |
★課時：
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質量保障 |
| 1、可免費在以后培訓班中重聽；
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3、培訓合格學員可享受免費推薦就業機會。 |
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課程大綱: |
FPGA與DSP聯合應用 |
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| FPGA與DSP聯合應用 |
| 課程簡介： |
DSP應用是展示FPGA優勢的最有效場合。通過本次課的學習，可以幫助學員掌握使用FPGA實現DSP的基本理論和實現方法。掌握針對DSP的Verilog編程方法，實現如Cordic算法、FFT
IP Core使用等經典內容。 |
| 培訓時長： |
四天 |
| 必備條件： |
熟練掌握Verilog HDL |
| 獲得技能： |
掌握使用FPGA實現DSP的基本理論和實現方法。 |
| 課程大綱： |
第一階段 |
| Verilog for DSP |
| 第二階段 |
| Cordic算法實現 |
| 第三階段 |
| 浮點算法的定點處理 |
| 第四階段 |
| 浮點數與定點數 |
| 第五階段 |
| 浮點如何轉定點 |
| 第六階段 |
| FPGA實現DSP的優勢及應用的典型場合 |
| 第七階段 |
| 多速率信號處理(中頻數字化的理論) |
| 第八階段 |
| 帶通采樣定理 |
| 第九階段 |
| 內插與抽取 |
| 第十階段 |
| FFT IP Core的使用方法 |
| 第十一階段 |
| FPGA+DSP架構分析 |
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