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        Cadence PCB設計初級培訓

         
          班級規模及環境--熱線:4008699035 手機:15921673576( 微信同號)
              每個班級的人數限3到5人,互動授課, 保障效果,小班授課。
          上間和地點
        上課地點:【上海】:同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】:北京中山學院/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領館區1號(中和大道) 【沈陽分部】:沈陽理工大學/六宅臻品 【鄭州分部】:鄭州大學/錦華大廈 【石家莊分部】:河北科技大學/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協同大廈
        最近開間(周末班/連續班/晚班):2018年3月18日
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          質量保障

               1、培訓過程中,如有部分內容理解不透或消化不好,可免費在以后培訓班中重聽;
               2、免費提供課后技術支持,保障培訓效果。
               3、培訓合格學員可享受免費推薦就業機會。☆合格學員免費頒發相關工程師等資格證書,提升職業資質。專注高端技術培訓15年,端海學員的能力得到大家的認同,受到用人單位的廣泛贊譽,端海的證書受到廣泛認可。

        課程大綱
         
        • 學習目標:
        • Cadence培訓初級班主要為您介紹從原理圖輸入到印刷電路板光繪制造文件輸出的全線PCB設計流程,通過講課及上機練習相結合的方式完成Cadence的原理圖工具Concept- HDL、PCB工具Allegro以及相應的建庫工具的使用方法的系統培訓。通過培訓學員可掌握先進的Cadence PCB設計流程,完成PCB設計。
          基本要求:
          學員學習本課程應具備下列基礎知識:
          ◆有微機原理和匯編語言的基礎;
          ◆熟悉C語言編程;
          ◆了解數字信號處理原理
          課程大綱:
          1 Concept HDL基本設計流程
          Concept HDL Basic Board Design Flow
          2 設計輸入 Design Entry
          2.1 Project Setup
          2.2 Editing a Schematic - Part Libraries, Adding Parts, Adding Wires,Naming Wires
          2.3 Concept Error Checking
          2.4 Design Libraries
          2.5 Working with Groups
          2.6 Copying, Adding, Inserting, and Moving PagesDeleting Pages
          2.7 The CheckPlus Tool
          2.8 Cross Referencing Signals
          2.9 Plotting the Schematic
          2.10 Part Tables
          2.11 Packaging
          2.12 Bill of Materials
          3 從原理圖到PCB:PackageXL 工具使用
          3.1 Introduction to Board Layout
          3.2 Mainstream Board Design
          3.3 Design Synchronization
          3.4 Netlist Files
          3.5 Export Physical
          4 層次化設計 Hierarchical Design
          4.1 Components of a Hierarchical Block
          4.2 Creating Hierarchical Block Symbols
          4.3 Top-Down Design
          5 PCB設計準備:Allegro環境、規則設置、PCB布局布線
          5.1 Allegro User Interface
          5.2 Managing the Allegro Work Environment
          5.3 Padstack Designer
          5.4 Component Symbols
          5.5 Board Design Files
          5.6 Importing Logic Information into Allegro
          5.7 Setting Design Constraints
          5.8 Component Placement
          5.9 Routing and Glossing
          6 建立元件庫 PCB Librarian Expert
          6.1 Design Processes and Library Models
          6.2 Setting Up a Build Area
          6.3 The Symbol View
          6.4 The Chips View
          6.5 The Part Table View
          6.6 The Simulation View
          6.7 Testing the Part
          6.8 Creating a Split Part
          6.9 Importing Text Files
          7 PCB數據后處理:覆銅、生產加工數據輸出
          7.1 Copper Areas and Positive or Negative Planes
          7.2 Preparing for Post Processing
          7.3 Renaming Reference Designators
          7.4 Backannotation
          7.5 Creating Silkscreens
          7.6 Creating Checkplots
          7.7 Generating Artwork
          7.8 The Aperture File
          7.9 Film Control
          7.10 Generating Gerber Files
          7.11 Creating Fabrication Drawings
          7.12 Generating an NC Drill File
          7.13 Creating the Parameters File
          7.14 Creating Assembly Drawings
         

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          備.案.號:滬ICP備08026168號-1 .(2024年07月24日)...............
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