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               每期人數限3到5人。
           上課時間和地點
        上課地點:【上海】:同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學成教院 【北京分部】:北京中山學院/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領館區(qū)1號(中和大道) 【沈陽分部】:沈陽理工大學/六宅臻品 【鄭州分部】:鄭州大學/錦華大廈 【石家莊分部】:河北科技大學/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協(xié)同大廈
        最近開課時間(周末班/連續(xù)班/晚班):2025年4月7日--即將開課-----即將開課,歡迎垂詢
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           質量保障

                1、可免費在以后培訓班中重聽;
                2、免費提供課后技術支持,保障培訓效果。
                3、培訓合格學員可享受免費推薦就業(yè)機會。

        課程大綱
         
        1. 利用系統(tǒng)生成器(System Generator)實現的DSP設計培訓
          ? 利用系統(tǒng)生成器(System Generator)實現的DSP設計培訓
          課程對象
          對 DSP 設計培訓感興趣、正在利用 MathWorks MATLAB? 和 Simulink? 軟件實現 DSP 算法以及希望使用 Xilinx System Generator for DSP 設計的系統(tǒng)工程師、系統(tǒng)設計者、邏輯設計者與有經驗的硬件工程師
        2. 課程概要
          1
          系統(tǒng)生成器簡介
          Simulink 軟件基礎
          實驗1:利用 Simulink 軟件
          Basic Xilinx Design Capture
          實驗2:利用 Xilinx 系統(tǒng)生成器著手設計
          Signal Routing
          實驗3:信號路由
          實現系統(tǒng)控制
          實驗4:實現系統(tǒng)控制
          2
          多速率系統(tǒng)
          實驗5:設計基于 MAC 的 FIR
          Filter Design
          實驗6:利用 FIR 編譯器模塊設計 FIR 濾波器
          System Generator、 Vivado Design Suite、項目導航器和 XPS 集成
          實驗 7:?System Generator 和 Vivado IDE 集成
          Kintex-7 FPGA DSP 平臺
          實驗 8a:?System Generator 和 Vivado HLS 工具集成
          實驗 8b:?AXI-4 Lite 接口綜合

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