曙海教育集團(tuán)
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        嵌入式OS--4G手機(jī)操作系統(tǒng)
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           Prime Time & Design Compiler培訓(xùn)
           班級規(guī)模及環(huán)境--熱線:4008699035 手機(jī):15921673576( 微信同號)
               每期人數(shù)限3到5人。
           上課時(shí)間和地點(diǎn)
        上課地點(diǎn):【上海】:同濟(jì)大學(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】:電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院 【北京分部】:北京中山學(xué)院/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領(lǐng)館區(qū)1號(中和大道) 【沈陽分部】:沈陽理工大學(xué)/六宅臻品 【鄭州分部】:鄭州大學(xué)/錦華大廈 【石家莊分部】:河北科技大學(xué)/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協(xié)同大廈
        最近開課時(shí)間(周末班/連續(xù)班/晚班)
        Prime Time & Design Compiler培訓(xùn):2025年4月7日--即將開課-----即將開課,歡迎垂詢
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             ☆資深工程師授課

                
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          Prime Time & Design Compiler培訓(xùn)


        第一階段 Prime Time

        Unit 1

        ??設(shè)計(jì)是否滿足時(shí)序要求?
        ??對象、屬性、集合?
        ??時(shí)序報(bào)告中的約束?
        ??時(shí)序報(bào)告中的時(shí)序弧
        ??報(bào)告路徑的控制?

        Unit 2 ?

        ??報(bào)告小結(jié)?
        ??生成setup文件和運(yùn)行腳本?
        ??運(yùn)行腳本驗(yàn)證?
        ??了解設(shè)計(jì)中的時(shí)鐘?

        Unit 3?

        ??分析類型并反標(biāo)?
        ??進(jìn)一步的檢查和約束?


        Unit 4:

        Does your design meet timing?
        Objects, Attributes, Collections
        Constraints in a timing report
        Timing arcs in a timing report
        Control which paths are reported

        Unit 5:

        Summary Reports
        Create a setup file and run script
        Validate a run script
        Getting to know your clocks

        Unit 6

        Debug the design clocks
        Analysis types and back annotation
        Additional checks and constraints
        Conclusion



        第二階段 Design Compiler

        Unit 1

        * Introduction to Synthesis
        * Setting Up and Saving Designs
        * Design and Library Objects
        * Area and Timing Constraints

        Unit 2

        * Partitioning for Synthesis
        * Environmental Attributes
        * Compile Commands
        * Timing Analysis
        * More Constraint Considerations

        Unit 3

        * More Constraint Considerations(lab)
        * Multiple Clock/Cycle Designs
        * Synthesis techniques and Flows
        * Post-Synthesis Output Data
        * Conclusion


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